אל תפספסו את ההצעה הכי משתלמת שלנו!!!
מנוי חופשי לכל הקורסים שלכם
בטח, ספרו לי עוד!
מבנה המחשב ~~סוגריים2~~חלקי~~סוגריים1~~ 11~~מקף~~327
מחיר הקורס: ₪249
לרכישת הקורס
כולל:
39 שעות

תלמידים יקרים, 

הקורס המוצע הוא חקלי בשלב זה ותכנים נוספים יעלו בהמשך. 
זמנית, הנושאים החסרים הם:
 - חיזוי הסתעפויות
 - זכרון מטמון וזיכרון וירטואלי
 - כלי פריפריאליים ומערכות קלט/פלט

אלו יתווספו במהלך הסמסטר.
תודה על ההבנה ובהצלחה בלמידה.
צוות האתר גול. 

תוכן הקורס
3 לחץ על העגלה להוספת התוכן המבוקש
  • פרק 1 - הקדמה כללית
    סקירה של מהפכת המחשבים, קטגוריות מחשוב, מודל שכבות החומרה והתוכנה, שכבות קוד (שפה עילאית, אסמבלי, שפת מכונה), גישת המחשב לעולם החיצוני: התקני I/O, זכרונות DRAM ו-SRAM, רשת מחשבים - Ethernet ו-Internet, מודל פון-נוימן (von-Neumann), ה-ISA, מעבד RISC ומעבד CISC.

    זמן: 1:14 שעות
  • פרק 2 - ייצוג מספרים - פרק חזרה כללי
    הפרק עוסק בייצוג מספרים עשרוניים ובינארים, 4 פעולות אריתמטיות עם מספרים בינאריים חיוביים, המספרים המשלימים וביצוע פעולות עם מספרים בינאריים מכוונים. נושאים נוספים בפרק לפי דרישה הם: קודים בינאריים שונים (קוד BCD, קוד GRAY, קודים משלימים, קודים ממושקלים, קודים ליניארים - המינג, אופן הכתיבה של קוד במשרד ובמקלט ויכולת גילוי ותיקון שגיאות) וייצוג מספרים בשיטת הנקודה הצפה (בפורמט IEEE754).

  • פרק 3 - בניית רכיבים לוגים
    יחידת ה-ALU (Arithmetic Logic Unit), אוגרים/מחסניות (Registers) ומקבץ האוגרים של המעבד (Register File).

  • פרק 4 - האסמבלי של מעבדי ה-MIPS
    עיקרון ההפשטה, ה-MIPS (חברה, הגדרה ומדד), מהו ה-ISA ומבנה הארכיטקטורה של מחשבי MIPS32, פקודות מסוגים R-Type, I-Type, J-Type. אוגר האפס, פעולות: add, sub, and, or, sll, srl, sra, lw, sw, beq, bne, j
    אוגרים מיוחדים: hi, lo, zero. מבנה זיכרון של מחשב MIPS32. אוגר ה-PC ותפקידו. פקודות על בתים בודדים, פסאודו פקודות: move, li, la, blt.

  • פרק 5 - המעבד החד-מחזורי (Single-Cycle Processor)
    נתיב הנתונים, יחידת בקרה ראשית, יחידת בקרה משנית, 5 שלבי המעבד: Instruction Fetch, Decode, Execute, Memory, Write Back, מימוש פקודות R-Type, מימוש פקודות lw ו-sw, מימוש פקודות beq ו-jump, הערכת זמנים וביצועי מעבד

  • פרק 6 - המעבד הרב-מחזורי (Multi-Cycle Processor)
    פיצול פקודות למספר מחזורי שעון (Multicycle processor): IF, ID, MEM, WB. אוגרים: A, B, IR, MDR, ALUOut. תוספות בחומרה, מימוש יחידת הזכרון באמצעות מערכת FSM, שלבי ביצוע הפקודות של מעבד MIPS רב-מחזורי, מימוש יחידת הבקרה עם ROM ועם PLA.

  • פרק 7 - מעבד העובד בשיטת הצנרת (Pipeline Processor)
    מהי הצנרה (pipeline), אוגרי הצנרת IF/ID, ID/EX, EX/MEM, MEM/WB ושלבים בצנרת, תרשים פעימות שעון רבות (multiple clock cycle pipeline diagram), תרשים פעימת שעון בודדת (single clock cycle pipeline diagram), קווי הבקרה של מעבד הצנרת, סיכונים בצנרת: סיכוני מבנה (structural hazards), סיכוני נתונים (data hazards), סיכוני בקרה (control hazards). פתרונות: עיכוב (stall) והכנסת nop בקוד, יחידת ההעברה (forwarding unit), יחידת איתור סיכונים (Hazard Detection Unit), שיטות חיזוי (Prediction).

  • פרק 8 - פסיקות וחריגות

    זמן: 30 דקות
  • פרק 9 - ייצוג מספרים בשיטת הנקודה הצפה
    ייצוג מדעי וייצוג בשיטת נקודה צפה (floating point), מספרים א-נורמלים (de-normalized) וערכים שמורים. נקודה צפה עם 8 ביטים ופעולות אריתמטיות - חיבור, חיסור, כפל, חילוק. שיטות עיגול והסיביות Guard, Round, Sticky. נקודה צפה ב-32 ביט (single precision) ונקודה צפה ב-64 ביט (double precision).

    זמן: 8:46 שעות